VerilogHDL:$displayの色々

VerilogHDLの$display関係で知らなかったものをメモ程度に。

サンプルコード


 1|module sub_m(input reg[3:0] in);
 2|  sub_mm hogehoge();
 3|  initial begin
 4|    #1;
 5|    $display("%m");
 6|    #3;
 7|    $display(in);
 8|    $displayb(in);
 9|    $displayo(in);
10|    $displayh(in);
11|  end
12|endmodule
13|
14|module sub_mm();
15|  initial begin
16|    #2;
17|    $display("%m");
18|  end
19|endmodule
20|
21|module tb;
22|  reg[3:0] tmp=10;
23|
24|  sub_m hoge(.in(tmp));
25|  sub_m mumumu(.in(tmp));
26|
27|  initial begin
28|    #100;
29|    $finish(1);
30|  end
31|
32|endmodule
33|

実行結果


# 10.0d

# vsim -L work -do {run -all; quit} -c tb
# Loading work.tb
# Loading work.sub_m
# Loading work.sub_mm
# run -all
# tb.hoge
# tb.mumumu
# tb.hoge.hogehoge
# tb.mumumu.hogehoge
# 10
# 1010
# 12
# a
# 10
# 1010
# 12
# a
# ** Note: $finish : tb.v(29)
というような感じです。
特に自分自身の階層を表示出来る「%m」に関しては知って驚ました!
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