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第一回SystemVerilog読書会行いました。

2013/3/9(土) 22:30〜 SystemVerilog読書会を行いました。
ログはこちらにあります。


SystemVerilog読書会 Archive


内容

最初ということで、第1章〜第3章(〜P22)を対象にしました。
ほぼ概要のところなので、ちょこちょこ詳細部分に飛んだりしましたが、
全体的に良かったと思います。


キーワード

module, program, logic, wire, reg, bit, checker, function,
fork, join_none, timescale, timeunit, timeprecision


次回

  • 日時:2013/3/16(土) 22:30〜
  • 内容:4. Scheduling semantics

初めてのトライアルなので、提案などドシドシいただければと思います。
また、UVMのソースコードや DVConなど資料読みなど出来ればと思ってます。
ROMで構いませんので、初心者の方も気軽に参加していただければと思います。

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