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[SystemC][TLM2] ST,ARM,Cadenceからの提案


STMicroelectronics, ARM and Cadence Improve Tool and Model Interoperability With Three Joint Contributions to Accellera Systems Initiative


ということで、さっそくダウンロード。
「introduction.pdf」に色々書いてあります。

  • Wire (Interrupt, reset, ...) Modeling in VP
    tlm_wireということで、bool型、TLM-1ベースでの実装を提案

  • Register & Memory Inspection API
    scireg APIにて、Register & Memory定義

  • System Address Map API
    transportdbginvalidatedirectmemptr()を使って制御。


下2つは SCMLと仲良くして欲しいな。


実際の動かしはまだ後日。

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