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[SystemVerilog] `begin_keywords/`end_keywords

毎週土曜日 22時から行っているぼっちSystemVerilog読書会 にて知らなったやつがあったので、紹介します。

  • `begin_keywords
  • `end_keywords


IEEE1800-2012の 「22.14.1 Examples」を見るとよくわかると思います。


  • LRMより引用
  • `begin_keywords "1364-2001" // use IEEE Std 1364-2001 Verilog keywords
    module m2 (...);
      reg [63:0] logic; // OK: "logic" is not a keyword in 1364-2001
      ...
    endmodule
    `end_keywords

    `begin_keywords "1800-2005" // use IEEE Std 1800-2005 SystemVerilog keywords
    module m2 (...);
      reg [63:0] logic; // ERROR: "logic" is a keyword in 1800-2005
      ...
    endmodule
    `end_keywords
  • バージョンの種類
  • | vesion_specifier |
    |--------------------|
    | 1800-2012 |
    | 1800-2009 |
    | 1800-2005 |
    | 1364-2005 |
    | 1364-2001 |
    | 1364-2001-noconfig |
    | 1364-1995 |

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