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[UVM][SystemVerilog] UVM1.2リリース

どうやら UVM1.2が正式にリリースされたようです。

Accellera Systems Initiative Releases UVM 1.2

UVM1.2での改善点などは後々として、こちらのブログが参考になるかと思います。

私は書くのが面倒くさいと思っていた

starting_phase.raise_objection(this);
// :
starting_phase.drop_objection(this);

が、

set_automatic_phase_objection(1);

で設定できるのは、楽だなと思っております。

あれ? User's Guideはいづこへ???

Enjoy! UVM!!!

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